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        MII接口一致性測試,接口信號質量測試

        單價: 面議
        發貨期限: 自買家付款之日起 天內發貨
        所在地: 直轄市 北京
        有效期至: 長期有效
        發布時間: 2023-12-17 03:51
        最后更新: 2023-12-17 03:51
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        MII Interface

        RMII: Reduced Media Independent Interface
        相比于MII接口,RMII有以下四處變化:

        TXCLK 和 RXCLK 兩個時鐘信號,合并為一個時鐘 REFCLK
        時鐘速率由 25MHz 上升到 50MHz,單向數據由 4 bits 變為 2 bits
        CRS 和 RXDV 合并為一個信號 CRSDV
        取消了 COL 信號
        RMII信號如下圖所示。RMII只要 9 根信號線,相比于MII的 18 根信號可謂有不少的刪減,在同一個系統中的多個設備可以共享 MDIO, MDC 和 REFCLK 信號線。

        圖3. RMII Interface

        GMII: Gigabit Media Independent Interface
        GMII接口的數據速率可達 1000Mbps,其時鐘頻率為 125MHz ,單向數據位寬 8 bits。GMII向下兼容MII,可以像MII一樣工作在 100Mbps 和 10Mbps 的數據速率。

        GMII接口信號包括三類,分別為:

        發送端信號:GTXCLK, TXCLK, TXD[0-7], TXEN, TXER
        接收端信號:RXCLK, RXD[0-7], RXDV, RXER, CRS, COL
        配置信號:MDIO, MDC
        發送端包括兩個時鐘信號 GTXCLK 和 TXCLK,當設備工作于 1000Mbps 模式時,TXD, TXEN, TXER 是與 GTXCLK (125MHz)同步的,而在 10/100Mbps 工作模式時,以上數據信號是同步于由PHY提供的TXCLK 的,其中 100Mbps 時是 25MHz,10Mbps 時是 2.5MHz。接收端時鐘只有一個時鐘信號 RXCLK,它是從接收數據中恢復的時鐘。

        圖4. GMII Interface

        RGMII: Reduced Gigabit Media Independent Interface
        RGMII相比于GMII減小將近一半的管腳數(24 → 12),通過以下兩種方式:

        1000Mbps模式下,在時鐘的上/下邊沿均采樣數據
        取消不重要的如 CRS, COL 等信號
        在RGMII接口中 MAC 在 TXC 上一直提供時鐘信號,而不像在GMII接口中那樣,10/100Mbps 模式下時鐘是由 PHY 提供(TXCLK),而 1000Mbps 模式下時鐘是由 MAC 提供(GTXCLK)。在RGMII中應用到源同步時鐘,即數據與時鐘信號是同步的。這要求在PCB設計中,要對時鐘信號額外增加 1.5~2 ns 的延遲以保證接收端的建立/保持時間滿足要求。在 RGMII v2.0 規范中有定義MAC/PHY內部延遲(RGMII-ID),由此避免PCB設計中再要增加這個延遲。

        在RGMII接口中:

        1000Mbps 模式,數據在時鐘的上/下邊沿均采樣
        10/100Mbps 模式,數據僅在時鐘上升沿采樣
        RXCTL 和 TXCLT 為復用的傳輸控制信號。RXCTL 在時鐘的上升沿代表 RXDV,在時鐘的下降沿代表(RXDV xor RXER);TXCTL 在時鐘的上升沿代表 TXEN,在時鐘的下降沿代表(TXEN xor TXER)。

        RGMII v1.3 采用 2.5V CMOS 電平,RGMII v2 采用 1.5V HSTL 電平。

        圖5. RGMII Interface

        SGMII: Serial Gigabit Media Independent Interface
        SGMII發送和接收時鐘頻率均為 625MHz,采用 DDR 模式,數據速率為1.25Gbps。SGMII相比于GMII,功耗更低,采用 SerDes 接口后管腳數更少。SGMII發送和接受數據各 1 對差分信號(LVDS),還有 1 對差分時鐘,共 6 根線。對于 MAC/PHY 中包括時鐘恢復電路(CDR, Clock and Data Recovery circuitry )的系統,TXCLK 可以省略,SGMII接口只需要 4 根線,相比于GMII( 24 根)和RGMII( 12 根)信號線大大減少!

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